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比如要設計一個具有語音識別功能的機器人，在機器人經過訓練之后，使機器人能對訓練人的命令做出應答，完成跳兩首舞曲、走步、轉向、轉頭、發射飛盤等動作。

語音識別可劃分為訓練和識別兩個過程。在第一階段，語音識別系統對人類的語言進行學習，把學習內容組成語音庫存儲起來，在第二階段就可以把當前輸入的語音在語音庫中查找相應的詞義或語義。

那么，經過訓練，訓練人可使用各種命令讓機器人完成許多有趣的動作，使得人機交互更具智能化。

這就是初級機器人所需要達到的標準，那么更復雜的就需要專用的操作系統、需要編寫對語音進行分頻、壓縮、編碼等等的算法，需要建立語音數據庫等等，總之一大堆麻煩等著楊小樂去處理。

那么，為了研發這個聽覺系統，楊小樂面臨的首要任務，就是要將這個在現在處于萌芽期的dsp和fpga的架構和算法研發出來，并提前申請專利，要知道前世那龐大的dsp芯片市場基本沒有華夏國什么事，基本上都是采購國外的芯片，畢竟遍地開發的dsp芯片設計公司基本上都將dsp的專利和架構，凡是腦袋里能夠想到的都提前堵死了！

因此，楊小樂決定在西德的時間，除了看有沒有可能召集到人才，組建科研團隊以外，就是用來完成dsp和fpga的架構、硬件算法電路、指令集等等！

其中，fpga芯片是數字通用ic，它雖然看起來像一塊cpu，其實是完全硬件實現的。后來因為寫代碼麻煩，對控制部分比較薄弱，本來跟其他cpu配合使用，即麻煩的算法cpu提交給fpga，fpga算完把結果再返回給cpu。

可是這樣外圍電路就變得麻煩。于是提出了soc設計方法，就是直接在fpga里寫一個cpu出來，既然fpga萬能，做個cpu自然毫無壓力。這其中還有軟核和硬核（即所謂的ip核）的區別，不過除了性能，使用方法大同小異。所謂ip核，就是把各種專用集成電路用硬件描述語言描述，然后燒到fpga里形成專門的電路，這樣就不必另外搭芯片了，所有的電路在一片fpga里面形成。

因此，設計fpga需要用專門的硬件描述語言來進行非常簡便的設計，設計出來的芯片根本就不需要進行‘流片’，而是直接上芯片生產線生產就可以了。

而這類硬件描述語言就叫做hdl，是電子系統硬件行為描述、結構描述、數據流描述的語言。利用這種語言，數字電路系統的設計可以從頂層到底層（從抽象到具體）逐層描述自己的設計思想，用一系列分層次的模塊來表示極其復雜的數字系統。

然后，利用電子設計自動化（eda）工具，逐層進行仿真驗證，再把其中需要變為實際電路的模塊組合，經過自動綜合工具轉換到門級電路網表。接下去，再用專用集成電路asic或現場可編程門陣列fpga自動布局布線工具，把網表轉換為要實現的具體電路布線結構。

前世hdl從發明到20世紀80年代，已出現了上百種硬件描述語言，對設計自動化曾起到了極大的促進和推動作用。

但是，這些語言一般各自面向特定的設計領域和層次，而且眾多的語言使用戶無所適從。因此，急需一種面向設計的多領域、多層次并得到普遍認同的標準硬件描述語言。

因此在20世紀80年代后期，vhdl和veriloghdl語言適應了這種趨勢的要求，先后成為ieee標準。

隨著系統級fpga以及系統芯片的出現，軟硬件協調設計和系統設計變得越來越重要。傳統意義上的硬件設計越來越傾向于與系統設計和軟件設計結合。硬件描述語言為適應新的情況，迅速發展，出現了很多新的硬件描述語言，像superlog、systemc、cynlibc++等等。

而這些都將是楊小樂需要提前布局，在以后的市場里，不說分宜本羹，至少不會花錢去申請別人公司的專利授權嘛。

花錢去買技術授權，而且這個技術授權費用還得一直持續到不采用這個技術為止，有些更苛刻的除了授權費之外，還得按產品的數量另外交一份錢，這是楊小樂不能接受的，也是所有有技術和超前眼光的穿越者所不能接受的！

否則，帶著金手指卻和沒有金手指的原住民一樣，那還穿個什么勁啊？直接買塊豆腐再重新轉世投胎一次！